Diferență între revizuiri ale paginii „Tutorial Xilinx ISim”

De la WikiLabs
Jump to navigationJump to search
Linia 27: Linia 27:
 
[[Fișier:isim6.png|500px]]
 
[[Fișier:isim6.png|500px]]
  
După salvarea fișierului sursă, în continuare trebuie să realizâm un modul de test. Pentru asta, vom repeta operația de adăugarea a unei noi surse (prin click-dreapta pe fereastra de ierarhie, unde acum exisă modulul '''Incrementer'''), doar că acum vom selecta tipul '''Verilog Test Fixture''', iar numele fișierului va fi '''TestIncrementer''':
+
După salvarea fișierului sursă, în continuare trebuie să realizâm un modul de test. Pentru asta, vom repeta operația de adăugarea a unei noi surse (prin click-dreapta pe fereastra de ierarhie, unde acum exisă modulul '''Incrementer''' și click pe '''New Source...'''), doar că acum vom selecta tipul '''Verilog Test Fixture''', iar numele fișierului va fi '''TestIncrementer''':
  
 
[[Fișier:isim7.png|500px]]
 
[[Fișier:isim7.png|500px]]
 +
 +
În continuare vi se va cere să selectați modulul pe care doriți să-l testați. În cazul nostru, avem o singură variantă: '''Incrementer''', deci selectați-l și dați click pe '''Next >''', apoi pe '''Finish''':
 +
 +
[[Fișier:isim8.png|500px]]
  
  
  
[[Fișier:isim8.png|500px]]
 
 
[[Fișier:isim9.png|500px]]
 
[[Fișier:isim9.png|500px]]
 
[[Fișier:isim10.png|500px]]
 
[[Fișier:isim10.png|500px]]
 
[[Fișier:isim11.png|500px]]
 
[[Fișier:isim11.png|500px]]
 
[[Fișier:isim12.png|500px]]
 
[[Fișier:isim12.png|500px]]

Versiunea de la data 16 februarie 2014 21:56

Orice simulare în Xilinx ISim începe cu un nou proiect, fie prin selectarea File->New Project, fie prin apăsarea butonului New Project de pe fereastra inițială:

Isim1.png

În fereastra care se deschide, sunteți invitați să completați numele proiectului, calea până la directorul în care vor fi salvate fișierele (pentru laborator, selectati /home/student/ise), precum și o scurtă descrie opțională. Apoi apăsați Next >:

Isim2.png

Următoarea fereastră conține un număr de setări ce au legătură cu modelul de FPGA folosit pentru sinteză. Aceste setări vor fi relevante pentru laborator. Acum, verificați doar că simulatorul ales este ISim, apoi dați click pe Next >:

Isim3.png

Va apărea o nouă fereastă cu un sumar al opțiunilor alese, după care, apăsând pe Finish, proiectul se va crea efectiv.

Următorul pas este să adăugăm fișiere la proiect. Acest lucru se realizează simplu, dând click-dreapta pe zona ierarhiei din stânga sus, acolo unde acum scrie Empty View și selectând New Source... din meniul contextual:

Isim4.png

În continuare vi se va cere tipul de sursă pe care doriți să o creați (selectați Verilog Module), numele fișierului (vom tasta Incrementer), și calea până la directorul în care se va salva (îl vom lăsa implicit). Apoi se dă click pe Next >:

Isim5.png

Vor mai apărea două ferestre în care se pot configura din interfață numărul și tipul porturilor modulului. Cum noi vom face asta manual, nu completați nimic și dați click pe Next >, iar apoi pe Finish.

În acest moment noua sursă este adăugată la proiect (și se vede în zona de ierarhie din stânga sus) iar fișierul este deschis automat pentru editare. Completați codul astfel încât să arate ca în figură:

Isim6.png

După salvarea fișierului sursă, în continuare trebuie să realizâm un modul de test. Pentru asta, vom repeta operația de adăugarea a unei noi surse (prin click-dreapta pe fereastra de ierarhie, unde acum exisă modulul Incrementer și click pe New Source...), doar că acum vom selecta tipul Verilog Test Fixture, iar numele fișierului va fi TestIncrementer:

Isim7.png

În continuare vi se va cere să selectați modulul pe care doriți să-l testați. În cazul nostru, avem o singură variantă: Incrementer, deci selectați-l și dați click pe Next >, apoi pe Finish:

Isim8.png


Isim9.png Isim10.png Isim11.png Isim12.png