Circuite integrate digitale (seminar): Diferență între versiuni
De la WikiLabs
Jump to navigationJump to search
Fără descriere a modificării |
Fără descriere a modificării |
||
| Linia 1: | Linia 1: | ||
Plecând de la noțiunile prezentate la curs, seminarul de Circuite Integrate Digitale introduce noțiunea de limbaj de descriere hardware (HDL) și are rolul de a familiariza studentul cu limbajul Verilog, precum și cu programe de simulare a circuitelor digitale ( | Plecând de la noțiunile prezentate la curs, seminarul de Circuite Integrate Digitale introduce noțiunea de limbaj de descriere hardware (HDL) și are rolul de a familiariza studentul cu limbajul Verilog, precum și cu programe de sinteză și simulare a circuitelor digitale (QuartusII sau ModelSim). | ||
* [[CID Seminar 1]] - Introducere în Verilog (variabile, blocuri, module de test, module funcționale și instanțiere) | * [[CID Seminar 1]] - Introducere în Verilog (variabile, blocuri, module de test, module funcționale și instanțiere) | ||
Versiunea de la data 19 februarie 2017 16:32
Plecând de la noțiunile prezentate la curs, seminarul de Circuite Integrate Digitale introduce noțiunea de limbaj de descriere hardware (HDL) și are rolul de a familiariza studentul cu limbajul Verilog, precum și cu programe de sinteză și simulare a circuitelor digitale (QuartusII sau ModelSim).
- CID Seminar 1 - Introducere în Verilog (variabile, blocuri, module de test, module funcționale și instanțiere)
- CID Seminar 2 - Instrucţiuni condiţionate, folosirea instrucţiunii always pentru definirea circuitelor combinaţionale
- CID Seminar 3 - Circuite secvențiale (semnalul de ceas, procese always și initial vs. assign, bistabil D)
- CID Seminar 4 - Numărătoare şi circuite cu numărătoare
- CID Seminar 5 - Descrierea memoriilor în Verilog
- CID Seminar 6 - Automate finite
