Contribuțiile utilizatorului Cbira
De la WikiLabs
Pentru Cbira discuție jurnal blocări încărcări jurnale
Un utilizator cu 796 modificări. Cont creat în 20 mai 2015.
7 octombrie 2020
- 12:457 octombrie 2020 12:45 dif ist −3 PC Laborator 1 →Mutatul unui fișier sau director (mv) actuală
- 12:447 octombrie 2020 12:44 dif ist +492 PC Laborator 1 →Mutatul unui fișier sau director (mv)
- 12:417 octombrie 2020 12:41 dif ist −518 PC Laborator 1 →Mutatul unui fișier sau director (mv)
- 12:367 octombrie 2020 12:36 dif ist −2 PC Laborator 1 →Copiatul unui fișier sau director (cp)
- 12:327 octombrie 2020 12:32 dif ist +14 PC Laborator 1 →Exerciții
- 12:317 octombrie 2020 12:31 dif ist 0 PC Laborator 1 →Exerciții
- 12:317 octombrie 2020 12:31 dif ist +95 PC Laborator 1 →Exerciții
- 12:067 octombrie 2020 12:06 dif ist 0 PC Laborator 1 →Instrucțiuni pentru lucrul cu sistemul de fișiere
4 octombrie 2020
- 12:474 octombrie 2020 12:47 dif ist +166 PC Laborator 1 →Sistemul de operare Linux - programe
- 08:254 octombrie 2020 08:25 dif ist +191 PC Laborator 1 →Linux Bash
8 martie 2020
- 08:578 martie 2020 08:57 dif ist −4 ACES - Vivado remote run Fără descriere a modificării actuală
- 08:568 martie 2020 08:56 dif ist +759 N ACES - Vivado remote run Configuration of client for Remote Host usage
4 martie 2020
8 octombrie 2018
- 13:158 octombrie 2018 13:15 dif ist +65 Programarea Calculatoarelor (curs seria C) →Curricula cursului actuală
- 13:158 octombrie 2018 13:15 dif ist 0 N Fișier:Curs1 PC.zip Fără descriere a modificării actuală
4 octombrie 2018
- 07:114 octombrie 2018 07:11 dif ist −2 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:114 octombrie 2018 07:11 dif ist −1 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:114 octombrie 2018 07:11 dif ist 0 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:104 octombrie 2018 07:10 dif ist 0 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:094 octombrie 2018 07:09 dif ist 0 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:084 octombrie 2018 07:08 dif ist +145 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:074 octombrie 2018 07:07 dif ist −1 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:074 octombrie 2018 07:07 dif ist −10 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:064 octombrie 2018 07:06 dif ist +2 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:064 octombrie 2018 07:06 dif ist 0 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:054 octombrie 2018 07:05 dif ist +81 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 07:044 octombrie 2018 07:04 dif ist 0 N Fișier:MIT6 087IAP10 lec04.pdf Fără descriere a modificării actuală
- 07:044 octombrie 2018 07:04 dif ist 0 N Fișier:MIT6 087IAP10 lec03.pdf Fără descriere a modificării actuală
- 07:044 octombrie 2018 07:04 dif ist 0 N Fișier:MIT6 087IAP10 lec02.pdf Fără descriere a modificării actuală
- 07:024 octombrie 2018 07:02 dif ist 0 N Fișier:MIT6 087IAP10 lec01.pdf Fără descriere a modificării actuală
- 07:024 octombrie 2018 07:02 dif ist +679 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 06:544 octombrie 2018 06:54 dif ist +6 Programarea Calculatoarelor (curs seria C) →Curricula cursului
- 06:544 octombrie 2018 06:54 dif ist +150 Programarea Calculatoarelor (curs seria C) →Materiale de studiu
- 06:434 octombrie 2018 06:43 dif ist +781 N Programarea Calculatoarelor (curs seria C) Pagină nouă: Dedicat studenților de anul I, semestrul I, cursul de programare a calculatoarelor are ca scop introducerea în domeniul programării și a științei calculatoarelor, precum și...
- 06:404 octombrie 2018 06:40 dif ist +8 Programarea Calculatoarelor (curs seria C,F) Fără descriere a modificării actuală
- 06:404 octombrie 2018 06:40 dif ist +157 N Programarea Calculatoarelor (curs seria C,F) Pagină nouă: * Programarea Calculatoarelor - seria F * Programarea Calculatoarelor - seria C
- 06:404 octombrie 2018 06:40 dif ist +6 Pagina principală →Materiale de curs
- 06:394 octombrie 2018 06:39 dif ist +4 Pagina principală →Materiale de curs
- 06:384 octombrie 2018 06:38 dif ist +69 Pagina principală →Materiale de curs
9 septembrie 2018
- 11:219 septembrie 2018 11:21 dif ist −27 Programare Orientată Obiect (curs) - Seria C →ANUNTURI actuală
30 mai 2018
- 10:5430 mai 2018 10:54 dif ist 0 Verilog EN →Concatenation operator actuală
- 10:3630 mai 2018 10:36 dif ist +12 Verilog EN →Operators
- 10:3030 mai 2018 10:30 dif ist +18 Verilog EN →Operators
- 10:2130 mai 2018 10:21 dif ist +1 Verilog EN →Arithmetic Operators
- 10:2030 mai 2018 10:20 dif ist 0 Verilog EN →Clock signal in test modules
- 10:1930 mai 2018 10:19 dif ist +31 Verilog EN →Clock signal in test modules
- 10:1630 mai 2018 10:16 dif ist +9 Verilog EN →Instantiation blocks
- 10:1530 mai 2018 10:15 dif ist +3 Verilog EN →Instantiation blocks
- 10:1430 mai 2018 10:14 dif ist −2 Verilog EN →always sequential blocks. Non-blocking assignments
- 10:1230 mai 2018 10:12 dif ist +4 Verilog EN →always sequential blocks. Non-blocking assignments
- 10:1130 mai 2018 10:11 dif ist +1 Verilog EN →Combinational always blocks
- 10:1130 mai 2018 10:11 dif ist +1 Verilog EN →assign blocks
- 10:0930 mai 2018 10:09 dif ist +1 Verilog EN →assign blocks
- 10:0830 mai 2018 10:08 dif ist −6 Verilog EN →Implementing Verilog Modules
- 09:5830 mai 2018 09:58 dif ist +22 Verilog EN →Fire (wire) and registers (reg)
- 09:5630 mai 2018 09:56 dif ist +7 Verilog EN →Fire (wire) and registers (reg)
- 09:5430 mai 2018 09:54 dif ist +16 Verilog EN →Implementing Verilog Modules
- 09:4930 mai 2018 09:49 dif ist −6 Verilog EN →Verilog Module Interface
- 09:4830 mai 2018 09:48 dif ist +13 Verilog EN →Verilog Module Interface
- 09:4430 mai 2018 09:44 dif ist −3 Verilog EN →Verilog Module Interface
- 09:4330 mai 2018 09:43 dif ist −4 Verilog EN →Verilog Module Interface
- 09:3630 mai 2018 09:36 dif ist −1 DIC Lab Work 5 →Exercise actuală
- 09:3530 mai 2018 09:35 dif ist +52 DIC Lab Work 5 →Exercise
- 09:3430 mai 2018 09:34 dif ist −12 DIC Lab Work 5 →Example
- 09:3230 mai 2018 09:32 dif ist 0 DIC Lab Work 4 →Notions and Knowledge Required actuală
- 09:3230 mai 2018 09:32 dif ist +1.596 N Pulse generator with variable duty cycle Pagină nouă: Impulse generator with variable fill factor. Limit value set at 32. Pulse generator with variable duty cycle is a circuit that generates a rectangular signal... actuală
- 09:3030 mai 2018 09:30 dif ist −1 DIC Lab Work 4 →Notions and Knowledge Required
- 09:3030 mai 2018 09:30 dif ist +1 DIC Lab Work 4 →Notions and Knowledge Required
- 09:2830 mai 2018 09:28 dif ist −1 DIC Lab Work 4 →Bonus Exercise
- 09:2830 mai 2018 09:28 dif ist −14 DIC Lab Work 4 →Exercise
- 09:2830 mai 2018 09:28 dif ist −1 DIC Lab Work 4 →Example
- 09:2730 mai 2018 09:27 dif ist +13 DIC Lab Work 4 →Exercise
- 09:2730 mai 2018 09:27 dif ist +1 DIC Lab Work 4 →Bonus Exercise
- 09:2630 mai 2018 09:26 dif ist −8 DIC Lab Work 4 →Exercise
- 09:2530 mai 2018 09:25 dif ist +5 DIC Lab Work 2 →Exercise 6 actuală
- 09:2430 mai 2018 09:24 dif ist −9 DIC Lab Work 2 →Exercise 6
- 09:2430 mai 2018 09:24 dif ist −9 DIC Lab Work 2 →Exercise 5
- 09:2430 mai 2018 09:24 dif ist −9 DIC Lab Work 2 →Exercise 4
- 09:2430 mai 2018 09:24 dif ist +1 DIC Lab Work 2 →Exercise 2
- 09:2430 mai 2018 09:24 dif ist +8 DIC Lab Work 2 →Exercise 2
- 09:2230 mai 2018 09:22 dif ist −9 DIC Lab Work 2 →Exercise 2
- 09:2230 mai 2018 09:22 dif ist −9 DIC Lab Work 2 →Exercise 1
- 09:2130 mai 2018 09:21 dif ist −3 DIC Lab Work 2 →Exercises
- 09:2130 mai 2018 09:21 dif ist +1 DIC Lab Work 2 →Example 2
- 09:1930 mai 2018 09:19 dif ist +1 DIC Lab Work 2 →Example 1
- 09:1930 mai 2018 09:19 dif ist +159 DIC Lab Work 1 Fără descriere a modificării
- 09:1530 mai 2018 09:15 dif ist −2 DIC Lab Work 1 →Example
- 09:1530 mai 2018 09:15 dif ist +13 DIC Lab Work 1 →Exercise 1
- 09:1430 mai 2018 09:14 dif ist +1 DIC Lab Work 1 →Example
- 09:1330 mai 2018 09:13 dif ist −11 DIC Lab Work 0 →Development board actuală
- 09:1130 mai 2018 09:11 dif ist −3 Introduction to FPGA synthesis. Xilinx ISE. →Available FPGA boards actuală
- 09:0930 mai 2018 09:09 dif ist −6 Introduction to FPGA synthesis. Xilinx ISE. →Available FPGA boards
- 09:0930 mai 2018 09:09 dif ist −2 Introduction to FPGA synthesis. Xilinx ISE. →Available FPGA boards
- 09:0830 mai 2018 09:08 dif ist +226 Introduction to FPGA synthesis. Xilinx ISE. →Available FPGA boards
- 09:0030 mai 2018 09:00 dif ist +1 Introduction. Verilog HDL (Verilog syntax) →Verilog HDL actuală
- 08:5930 mai 2018 08:59 dif ist +1 Introduction. Verilog HDL (Verilog syntax) →Computation and control
- 08:5630 mai 2018 08:56 dif ist +2 DIC Lab Work 5 →Exercise
- 08:5530 mai 2018 08:55 dif ist −4 DIC Lab Work 5 →Exercise